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如下左图、下右图所示，输入和输出反相。下左图中，A=1时光耦合器导通，Y=0；A=0时光耦合器载止，Y=l。下右图中，A=l时光耦合器截止，R3下拉使Y=0；A=0时光耦合器导通，Y=l。
本文关键字：耦合器 门电路 数字逻辑电路，单元电路 - 数字逻辑电路
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