引 言
目前，随着嵌入式系统在各个领域中的广泛应用，人们对嵌入式开发工具的需求也变得非常迫切。嵌入式系统的开发需要特殊的开发环境，一般包括交叉编译器、交叉调试器等。交叉调试器有两种实现方式：一种是片上调试，另一种是在目标机端运行监控程序来完成调试。前者是处理器的硬件调试模块支持的，如MIPS架构的EJTAG，国芯CPU的OnCE等，由于接近硬件底层，可以在裸机状态下提供调试手段，不仅可以调试监控程序、系统软件，也可以利用边界扫描单元来测试硬件电路及故障定位；而后者一般是在处理器正常工作后，才可以使用的一种调试手段。
EJTAG(Enhanced Joint Test Action Group)是MIPS公司根据IEEE 1149．1协议的基本构造和功能扩展而制定的规范，是一个硬件／软件子系统，在处理器内部实现了一套基于硬件的调试特性，用于支持片上调试。
龙芯一号 处理器 IP核 是在龙芯一号处理器基础上，对功耗、面积和性能等各方面进行改进而得到的高度灵活、适用于更广泛领域的处理器内核。它采用RISC架构，可运行MIPS III指令集，支持 EJTAG调试 功能，采用可配置架构，可在满足用户性能要求的前提下，实现最低成本的产品集成。
1 EJTAG工作机制及实现
1．1 EJTAG组成
所有MIPS的微处理器或是包含MIPS核的SoC芯片组件均提供对EJTAG调试的支持。EJTAG接口利用JTAG的TAP(Test ACCess Port)访问方式，将测试数据传入或者传出处理器核。EJTAG可实现的功能包括：访问处理器的寄存器、访问系统内存空间、设置软件／硬件断点、单步／多步执行等。如图1所示，EJTAG调试功能模块由4部分组成：CPU核内部的组件扩展，硬件断点单元，调试控制寄存器(DCR)以及TAP接口。
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1．2 EJTAG工作机制
处理器在某个调试例外(debug exception，如单步运行、断点等)产生以后，进入到调试模式(debug mode)，直到DERET指令执行以后从调试模式退出来。在这段时间里，处理器执行调试例外处理过程。在调试例外处理过程中，调试软件通过对TAP处理器的访问操作，实现了对普通寄存器的访问、协处理器的访问、系统内存空间的访问等功能。系统退出调试模式以后允许应用程序或是系统代码继续执行，直到遇到下一个调试例外。重复以上过程，EJTAG实现了单步运行或者多步运行等调试功能。
1．2．1 调试例外
在体系结构的设计上，EJTAG并不需要与CPU紧密结合，但CPU必须提供调试寄存器、进入调试模式和在调试模式下执行指令的能力，更重要的是调试例外的优先级必须高于其他处理器的例外(exception)。EJTAG调试是通过处理器的调试例外来实现的，调试例外将CPU从非调试模式(non-debug mode)转到调试模式。在调试模式下也可以再发生调试例外，这种例外就叫做“调试模式例外(debuIg mode exception)”。
MIPS 4KC处理器提供的调试例外如表1所列。
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当CPU执行了软件断点指令(SDBBP)，或者发生了单步调试，或者在EJTAG回路中产生了JtagBrk调试事件，或者发生了硬件断点时，CPU就会产生调试例外。SDBBP是一个标准的MIPS指令集指令，软件断点的设置就是调试软件通过把正常的应用程序代码替换成软件断点指令来实现的。EJTAG支持指令断点和数据断点两种类型的硬件断点，指令断点发生在处理器取指过程中，数据断点发生加载／存储传输过程中，它们可以设置在任何地址空间中，包括不能被改写的ROM空间。调试例外发生后，CPU首先屏蔽地址错误异常和中断异常，然后转向调试例外处理程序的执行。调试例外处理程序是由调试软件通过与TAP处理器的配合，利用EJTAG接口实现的。在调试模式下，CPU仍能够正常地访问协处理器和系统内存空间等处理器资源。
调试寄存器包括DEBUG寄存器、DEPC寄存器和DESAVE寄存器，都被定义在协处理器中。DEBUG寄存器保存了CPU进入调试模式的原因，以及同时是否发生了其他CPU例外的标志位，也被用来控制单步运行的设置。DEPC(Debug Exception Program Counter)寄存器保存了发生调试例外时将要执行的那条指令的地址，当退出调试模式后，该地址恢复到PC寄存器中。DESAVE (Debug Exception Save)寄存器是一个草稿寄存器，被调试软件用在对普通寄存器的处理过程中，该寄存器的内容不需要保存。
1．2．2 调试例外处理过程
所有的调试例外都有相同的基本流程：
①DEPC保存了中断返回后重新开始执行的指令PC值，设置DEBUG寄存器中的DBD位(表示DEBUG中断是否发生在分支延迟槽中)。如果不在延迟槽中，DEPC保存的就是当前的PC值；如果在延迟槽中，DEPC保存的就是那条跳转指令的PC值。
②根据调试例外更新Debug寄存器中的内容DSS，DBp，DDBL，DDBS，DIB，DINT位)。
③DEBUG寄存器中的DExcCode域变为非定义的。
④DEBUG寄存器中的Halt和Doze位更新。
⑤在调试处理开始时设置IEXI位来确定是否精确中断。
⑥DEBUG寄存器中的DM位设置为1。
⑦处理器开始从调试例外向量取指令进行例外处理。
处理过程用程序描述如下：
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2 龙芯一号 处理器 IP核 简介
龙芯一号处理器IP核是北京神州龙芯集成电路设计有限公司与中国科学院计算技术研究所共同研制的，兼顾通用及嵌入式CPU特点的32位处理器内核。龙芯一号处理器IP核具有可配置特性，用户可以根据自己的需求进行选择配置，从而定制出最适合用户应用的处理器结构。图2显示了龙芯一号IP核的可配置结构，其中虚线部分表示用户可根据自己的需求进行选择配置，从而定制出最适合用户应用的处理器结构。
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GS32S是龙芯一号处理器系列中的一款，采用RISC架构，可运行MIPS III指令集，有7级流水线，具有32位整数单元，典型工作频率为200～266 MHz，典型功耗为0．5W。GS32S不含浮点部件(FPU)、媒体部件(MMX)，以及哈佛结构SRAM接口。固定内核、EJTAG、TLB、Cache、AMBA接口和协处理器接口为固定配置。图2中的阴影部分为GS32S处理器的配置模块。
3 GS32S处理器 EJTAG调试 的实现
3．1 TAP处理器的访问
GS32S CPU从EJTAG Probe取指执行，或向EJTAGProbe访问数据(Load／Store)，实现处理器进入调试模式后的调试例外执行，整个处理过程需要调试软件通过Probe监测进行。在这种情况下，EJTAG的TAP就相当于一个从设备，TAP模块接收处理器内部对dmseg段进行的取指、Load／Store操作等发出的访问，等待外部响应。
GS32 CPU处于调试模式时，如果ProbEn有效，则对0xFF200000～0xFF2FFFFF的访问转向dmseg段；如果ProbTrap有效，则发生调试例外的处理器转向0xFF200200取指。TAP处理器访问流程如图3所示。
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发生调试例外时，如果DCR中的ProbTrap位是1，则GS32S CPU跳转到0xFF20 0200取指执行的过程如下：
①处理器把PC值(如0xFF200200)送到TAP模块中的Address寄存器中。
②处理器写TAP模块中的ECR寄存器，设置PrACC=1，PRnW=0，Psz[1：0]=2。
③处理器不停地测试PrAcc位，为1处于等待状态。
④EJTAGProbe选择ECR寄存器，串行移出其内容，看PrAcc 位是否为1。为1表示处理器等待通过TAP输入要执行的指令，同时也表示地址寄存器的值是有效的。
⑤EJTAG Probe判断ECR寄存器的PRnW位，0表示读。
⑥EJTAGProbe选择地址寄存器，并移出其内容。
⑦EJTAG Probe选择数据寄存器，把对应于上一步地址的指令移入数据寄存器里。
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