中断处理程序的第一步是要先清除S3C2440A的中断悬挂寄存器和中断源寄存器相应的位。这是为了能够继续响应FPGA产生的中断。为了能够让FIFO能及时的接收到新数据，把写状态寄存器放到中断的一开始，即第二步就是写状态寄存器相应位，通过置1清除状态使AD中断能够继续产生。最后读取FIFO的数据。使用中断后数据的传输效率大大得到提高，能够满足实际的采集需要。
4.结束语
本方案中的采集板充分利用了ARM的灵活性和FPGA的并行性的特点，实现了适用于高速数据采集板的设计。方案采用S3C2440A作为主控芯片，通过千兆以太网接口实时地将采集的数据传输到上位机PC机，上位机可实时控制目标数据采集。FPGA芯片在控制A/D转换芯片的同时，将数据存储在SRAM中，并通过DMA接口与S3C2440A进行数据传输。实验表明，本采集板的实时性和高速性能够满足系统的设计要求，可广泛应用于各种数据采集系统中。
本文关键字：数据采集 科研成果，电子知识资料 - 科研成果
上一篇：多功能电路模块设计
